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== Memory Controller ==
 
== Memory Controller ==

Revision as of 16:48, 14 May 2019

TODO: descrizione uart_router, memory_controller, con riferimento a template nexys4ddr, (comandi, console) e memoria, disegno/schema, interazione con host, loading memoria, avvio kernel

Nexys4DDR.jpg

Memory Controller

da AXI a DDR

Host interaction

Uart controller e traduzione in items per nu+ (da uart_router)

Console commands

uart_loader.py

Starting a Kernel